DevBJ Tag: Parameter
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- FPGA/ASICUpdated:
Verilog parameter는 named override로 지정하고 defparam은 피하기
재사용 모듈의 폭과 설정값은 parameter로 노출하고, 인스턴스에서는 이름이 있는 parameter override를 사용하는 기준입니다.
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재사용 모듈의 폭과 설정값은 parameter로 노출하고, 인스턴스에서는 이름이 있는 parameter override를 사용하는 기준입니다.